该校教授潘建伟、朱晓波、彭承志和副教授陈福升等，基于超导量子处理器“祖冲之3.2号”在码距为7的表面码上实现了低于纠错阈值的量子纠错，演示了逻辑错误率随码距增加而突出下降。在前期商讨基础上，该领域大学团队基于107比特“祖冲之3.2号”量子处理器，提出并成功实践了一种全新的“全微波量子态泄漏抑制架构”。如果物理量子比特的原始错误率过高，增大纠错码距带来的额外错误反而会淹没纠错带来的收益，导致“越纠越错”。实现容错通用量子计算机的必需条件是经过量子纠错抑制量子比特的错误率以满足大规模集成的要求。表面码是目前最成熟的量子纠错计划之一。然而，量子纠错需要引入大量额外的量子比特和量子门操作，导致更多的噪声源和错误通道。其中，“泄漏错误”尤为致命——该行业规模的扩大，泄漏错误的累积效应将成为阻碍纠错性能提升的核心瓶颈。这一成果标志着我国达到了“低于阈值，越纠越对”的关键里程碑，这一商讨更为高效的“全微波控制”新路径，为未来大规模容错该领域基础。因此，该范围的整体操控精度突破一个严苛的“纠错阈值”，从而实现“越纠越对”的量子纠错，这一研究能否从实验室原型走向实用化的关键分水岭。该成果以封面论文和“”的形式发表于国际学术期刊《物理评论快报》，美国物理学会《物理》栏目进行专题报道。研究团队结合全微波量子态泄漏抑制架构，实现了码距为7的表面码逻辑比特。实验结果显示，逻辑错误率随码距增添突出下降，错误抑制因子达到1.4，该行业已工作在纠错阈值之下，成功达到了“越纠越对”的目标。
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